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Verilog HDL数字系统设计
  • 王建民，田晓华，江晓林编著 著
  • 出版社： 哈尔滨：哈尔滨工业大学出版社
  • ISBN：9787560331690
  • 出版时间：2011
  • 标注页数：357页
  • 文件大小：14MB
  • 文件页数：369页
  • 主题词：硬件描述语言，Verilog HDL－程序设计

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图书目录

第1章 数字系统设计概述1

1.1 引言1

1.2 ASIC和FPGA2

1.3 数字设计的层次3

1.4 硬件描述语言5

1.5 典型设计流程7

本章小结8

习题与思考题18

第2章 组合逻辑电路设计回顾9

2.1 数字电路的基本概念9

2.2 布尔代数和逻辑门10

2.3 逻辑函数的化简14

2.4 组合逻辑电路的设计方法18

2.5 若干常用组合逻辑电路19

本章小结28

习题与思考题228

第3章 时序逻辑设计回顾29

3.1 时序逻辑电路29

3.2 基本存储元件30

3.3 时序逻辑电路的分析35

3.4 时序逻辑电路的设计38

3.5 若干常用的时序逻辑电路41

本章小结47

习题与思考题347

第4章 Verilog硬件描述语言49

4.1 引言49

4.2 第1个Verilog HDL实例49

4.3 基本词法规定50

4.4 数据类型52

4.5 程序框架55

4.6 结构级描述57

4.7 门级描述60

4.8 Tesbench64

本章小结66

习题与思考题466

第5章 组合逻辑电路68

5.1 引言68

5.2 连续赋值语句68

5.3 Verilog HDL操作符70

5.4 组合逻辑always块73

5.5 If语句76

5.6 case语句83

5.7 条件语句的综合86

5.8 可重用设计89

5.9 组合逻辑电路设计实例93

5.10 高效的HDL描述109

5.11 组合逻辑电路设计要点129

本章小结133

习题与思考题5133

第6章 基本时序逻辑电路135

6.1 引言135

6.2 时序逻辑电路135

6.3 同步时序逻辑电路138

6.4 基于原语的时序电路设计140

6.5 基本存储元件的Verilog HDL实现142

6.6 设计实例146

6.7 时序逻辑电路的Testbench159

6.8 时序逻辑电路设计要点162

本章小结170

习题与思考题6171

第7章 同步时序逻辑电路的时序分析172

7.1 引言172

7.2 Verilog HDL的抽象层次172

7.3 同步时序电路的时序分析方法174

7.4 组合逻辑的传播延迟177

7.5 时序逻辑电路的传播延迟179

7.6 提高电路的最高工作频率184

7.7 提高电路的建立时间和保持时间187

本章小结188

习题与思考题7188

第8章 有限状态机190

8.1 引言190

8.2 有限状态机190

8.3 米利状态机和摩尔状态机191

8.4 状态转换图和算法状态机图196

8.5 有限状态机的性能和时序201

8.6 状态赋值203

8.7 FSM的Verilog HDL实现208

8.8 输出缓冲器222

8.9 设计实例229

本章小结237

习题与思考题8237

第9章 数据通道（FSMD）239

9.1 引言239

9.2 寄存器传输级设计240

9.3 FSMD设计原理242

9.4 FSMD设计方法和步骤245

9.5 流水线设计259

9.6 FSMD设计实例273

本章小结279

习题与思考题9279

第10章 FSMD设计实践281

10.1 引言281

10.2 定点数的表示及饱和算术运算281

10.3 混合方程284

10.4 混合方程的直接实现286

10.5 输入寄存器和输出寄存器290

10.6 流水线设计和流水线执行单元291

10.7 资源共享数据通道的设计295

10.8 带有握手信号的数据通道299

10.9 具有输入总线的数据通道302

10.10 递归计算、初始化和计算307

10.11 复杂数据通道的设计方法311

10.12 寄存器的Schedule314

10.13 数据流图的等价变形320

本章小结321

习题与思考题10321

第11章 SPI主机接口设计322

11.1 引言322

11.2 SPI总线标准322

11.3 SPI主机功能描述324

11.4 微控制器接口模块327

11.5 SPI主机接口模块337

本章小结356

习题与思考题11356

参考文献357

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