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迭代检测伪码捕获技术
  • 王伟,李欣著 著
  • 出版社: 北京:国防工业出版社
  • ISBN:9787118093162
  • 出版时间:2014
  • 标注页数:206页
  • 文件大小:28MB
  • 文件页数:221页
  • 主题词:扩频通信-信息代码-迭代法-信号检测

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图书目录

第1章 扩频通信系统1

1.1 概述1

1.2 扩频通信系统的基础知识1

1.2.1 扩频通信系统的概念1

1.2.2 扩频通信系统的基本原理2

1.2.3 扩频通信系统的类型4

1.2.4 扩频通信系统的基本参数5

1.2.5 扩频通信系统的特点6

1.3 伪随机序列9

1.3.1 伪随机序列的基本概念9

1.3.2 m序列12

1.3.3 Gold码16

1.3.4 其他扩频序列19

1.4 同步原理22

1.4.1 同步及其不确定性的来源22

1.4.2 捕获方法及性能分析25

1.4.3 跟踪原理及性能分析38

第2章 迭代检测的基础知识54

2.1 概率的基础知识54

2.1.1 随机事件与样本空间54

2.1.2 频率与概率55

2.1.3 随机变量与随机过程56

2.1.4 全概率公式、贝叶斯法则和马尔可夫链57

2.1.5 内在概率、外概率和后验概率58

2.2 信号检测与估计59

2.2.1 贝叶斯判决准则59

2.2.2 复合假设检验60

2.2.3 MAP-SqD与MAP-SyD61

2.2.4 边缘与联合操作63

2.3 迭代检测思想来源——Turbo码64

2.3.1 信道编译码发展64

2.3.2 Turbo码迭代检测的基本原理66

2.4 迭代检测相关知识和应用69

2.4.1 迭代检测算法的基本流程69

2.4.2 最佳迭代接收的条件71

2.4.3 迭代接收机的性能分析工具72

2.4.4 迭代检测的应用73

第3章 因子图理论78

3.1 因子图的基础知识78

3.1.1 因子图的基本概念79

3.1.2 因子图的应用82

3.1.3 因子图中消息传递策略84

3.2 基于图模型理论的和积算法85

3.2.1 计算一个边缘函数86

3.2.2 计算多个边缘函数86

3.2.3 因子图上和积算法的信息传递86

3.3 和积运算与最小和算法87

3.3.1 和积运算87

3.3.2 最小和算法88

3.4 基于因子图的迭代检测伪码捕获方法89

3.4.1 一般译码模型的建立89

3.4.2 迭代译码算法92

3.4.3 基于因子图的迭代检测伪码捕获方法96

第4章 迭代检测伪码捕获方法103

4.1 m序列迭代检测捕获算法103

4.1.1 基于和积算法的m序列捕获103

4.1.2 基于最小和算法的m序列捕获108

4.1.3 基于隐藏节点因子图的m序列捕获算法112

4.1.4 m序列迭代检测捕获算法性能仿真与分析115

4.2 Gold码迭代检测捕获算法119

4.2.1 Gold码校验关系的确定119

4.2.2 校验关系分析122

4.2.3 Gold码的冗余校验捕获125

4.2.4 Gold码的分层校验捕获127

4.2.5 Gold码迭代捕获的仿真分析130

4.3 迭代检测伪码捕获方法的性能分析134

4.3.1 基于密度进化的收敛性分析134

4.3.2 基于EXIT图的收敛性分析139

4.3.3 本地码同步方法及其捕获性能分析144

第5章 迭代检测伪码捕获方法的优化156

5.1 基于迭代软信息的同步误差消除156

5.1.1 数字平均技术对初始码片信道信息的优化156

5.1.2 基于最大似然估计的码片定时误差消除160

5.1.3 基于三阶累积量的码片定时误差消除162

5.2 迭代检测捕获算法的复杂度分析与改进167

5.2.1 伪码迭代捕获算法的复杂度分析167

5.2.2 低存储复杂度迭代译码算法168

5.2.3 低运算复杂度向量选择算法170

5.3 多用户m序列迭代检测捕获算法171

5.3.1 多用户联合初始信息进化方法172

5.3.2 多重迭代捕获算法174

5.3.3 多用户迭代捕获算法设计174

第6章 迭代检测伪码捕获方法的FPGA设计与实现177

6.1 迭代检测伪码捕获方法的FPGA架构177

6.1.1 算法功能模块的划分177

6.1.2 位宽设计180

6.2 控制通路设计181

6.2.1 主状态机设计181

6.2.2 信息初始化状态机设计183

6.2.3 前向递归状态机与后向递归状态机设计185

6.3 数据通路设计189

6.3.1 数据采集模块设计189

6.3.2 计算逻辑模块设计190

6.3.3 消息存储阵列设计192

6.4 恢复与判决单元设计195

6.4.1 捕获判决控制器设计195

6.4.2 伪码序列恢复模块设计197

6.4.3 门限判决模块设计198

6.5 系统联调与测试结果200

参考文献203

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