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目录1

第一章 386微型计算机硬件系统概述1

§1.1 386微型计算机系统硬件构成及原理1

§1.2 386微型计算机系统板概述5

§1.3 386微型计算机专用芯片组简介6

第二章 386微型计算机CPU7

§2.1 概述7

§2.2 386微型计算机CPU内部结构9

§2.3 386微型计算机CPU操作方式12

§2.4 中断和异常22

§2.5 特权级保护多任务流水线32

§2.6 386微型计算机指令系统概述48

§2.7 内部寄存器54

§2.8 局部总线接口和主要操作时序62

§2.9 386微型计算机CPU与I/O电路的接口83

§2.10 386微型计算机CPU与其它IntelCPU的主要区别88

附表91

第三章 协处理器116

§3.1 80287协处理器116

§3.2 387协处理器122

§3.3 386与80287/387接口电路132

§3.4 Weitek协处理器148

§4.2 时钟发生器及总线控制 82C301155

第四章 时钟发生器及总线控制电路155

§4.1 概述155

§4.3 82C301外部电路分析175

第五章 动态存储器DRAM子系统177

§5.1 DRAM子系统概述177

§5.2 页／交着存储器控制芯片82C302199

§5.3 DRAM电路实例分析214

附图220

第六章 EPROM子系统229

§6.1 EPROM系统概述229

§6.2 EPROM子系统的组成229

§6.3 EPROM电路的工作原理234

第七章 高速缓存系统（cache）238

§7.1 高速缓存系统简介238

§7.2 高速缓存存储器的形成239

§7.3 高速缓存存储器的工作原理243

§7.4 82385高速缓存控制器246

§7.5 设计实例分析282

附录288

第八章 地址总线缓冲器电路293

§8.1 概述293

§8.2 高位地址缓冲器82A303293

§8.3 低位地址缓冲器82A304301

§9.1 概述311

第九章 数据总线缓冲器电路311

§9.2 数据总线缓冲器82A305内部结构312

§9.3 输入输出信号定义313

§9.4 基本工作原理315

§9.5 对外部数据总线的控制316

§9.6 操作时序320

第十章 控制缓冲器电路322

§10.1 概述322

§10.2 控制缓冲器82A306内部结构322

§10.3 输入输出信号定义322

§10.4 基本工作原理327

§10.5 对外部电路的控制328

§10.6 操作时序336

目录339

第十一章 外部设备控制电路339

§11.1 外部设备控制器82C206339

§11.2 DMA子系统347

§11.3 中断服务子系统358

§11.4 定时／计数器子系统366

§11.5 实时时钟子系统373

第十二章 键盘接口电路380

§12.1 概述380

§12.2 键盘控制器8742380

§12.3 键盘接口电路401

§1.3.1 概述408

第十三章 ATI/O总线408

§1.3.2 存贮器I/O及控制器的地址分配415

§13.3 扩展槽总规格及信号定义428

第十四章 系统操作时序458

§14 1 总线周期摘要458

§14.2 总线访问周期465

§14.3 DMA传送周期488

§14.4 存贮器刷新周期505

§14.5 总线仲裁周期509

§14.6 可兼容的外插接板设计要领512

第十五章 主机板总论524

§15.1 主机板内部工作流程526

§15.2 CPU对外插接资源的操作流程530

§15 3 中断服务流程531

§15.4 DMA操作流程531

第十六章 OPTI-386WB PC/AT芯片组简介533

§16.1 概述533

§16.2 系统控制器82C391534

§15.3 数据缓冲控制器82C392550

§16.4 时序图556

第十七章 系统板故障测试与维修方法564

§17.1 概述564

§17.2 测试设备574

§17.3 维修方法583